| 課程代碼 |
30D17203
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| 課程中文名稱 |
數位邏輯實習
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| 課程英文名稱 |
Digital Logic Practice
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| 學分數 |
1.0
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| 必選修 |
必修
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| 開課班級 |
四技系統一乙
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| 任課教師 |
謝文哲
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| 上課教室(時間) |
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週二
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第1節
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(J501)
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週二
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第2節
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(J501)
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| 課程時數 |
2
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| 實習時數 |
2
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| 授課語言 |
1.華語
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| 輔導考證 |
無
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| 課程概述 |
讓學生應用基本邏輯閘IC、組合邏輯IC(SSI/MSI)、正反器IC與計數器IC完成相關的基本與應用的邏輯電路、計數器/計時器的基本電路與計數器IC的應用電路等設計。
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| 先修科目或預備能力 |
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課程學習目標與核心能力之對應
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| 編號 | 中文課程學習目標 | 英文課程學習目標 | 對應系指標 |
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1
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了解基本邏輯閘特性及組合邏輯電路原理
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|
1 專業技能
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2
|
能完成相關實習並分析電路之正確性
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2 工程實務
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3
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能使用不同的邏輯電路達到相同之電路功能
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4 整合創新
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4
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能撰寫實習報告清楚的說明實習的過程及結果
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7 系統整合
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| 就業力培養目標 |
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校指標 |
1 |
2 |
3 |
4 |
5 |
6 |
7 |
8 |
9 |
10 |
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專業知識 |
實務技能 |
資訊能力 |
整合創新 |
外語能力 |
熱誠抗壓 |
表達溝通 |
敬業合群 |
人文素養 |
服務關懷 |
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30% |
30% |
0% |
40% |
0% |
0% |
0% |
0% |
0% |
0% |
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系指標 |
1 |
2 |
3 |
4 |
7 |
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6 |
8 |
|
9 |
5 |
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專業技能 |
工程實務 |
資訊能力 |
整合創新 |
系統整合 |
|
熱誠抗壓 |
專案管理 |
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社會責任 |
終身學習 |
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30% |
30% |
0% |
20% |
20% |
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0% |
0% |
|
0% |
0% |
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| 中文課程大綱 |
1.基本邏輯閘電路實習
2.組合邏輯電路實習
3.正反器電路實習
4.計數器/計時器電路實習
5.計數器IC應用電路實習
6.實作測驗
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| 英/日文課程大綱 |
1.Basic Logic gate practice
2.Combinational circuit practice
3.Flip-Flop circuit practice
4.Counter/Timer circuit practice
5.Counter IC circuit practice
6.Testing
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| 課程進度表 |
一、Mxplus II 與 Quartus II 軟體操作 (1~2週)
二、組合邏輯電路設計與實作 (7~9週)
半加減法器設計
4位元全加器設計
4位元加減法器設計
2-4 解碼器設計
4-2 編碼器設計
4-1 多工器設計
1-4 解多工器設計
比較器設計
三、循序邏輯電路設計與實作 (6~8週)
上數漣波計數器設計
下數漣波計數器設計
同步計數器設計
環形計數器設計
強生計數器設計
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| 課程融入SDGs |
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| 期考調查 |
| 期中考(第9週)考試方式 |
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| 期末考(第18週)考試方式 |
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| 其他週考試考試週次與方式 |
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| 教學方式與評量方式 |
| 課程學習目標 | 教學方式 | 評量方式 |
| 了解基本邏輯閘特性及組合邏輯電路原理 |
課堂講授
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實作
（
平時
）
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| 能完成相關實習並分析電路之正確性 |
實作演練
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實作
（
平時
）
|
| 能使用不同的邏輯電路達到相同之電路功能 |
課堂講授
實作演練
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實作
（
平時
）
實作
（
期中
）
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| 能撰寫實習報告清楚的說明實習的過程及結果 |
實作演練
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實作
（
期末
）
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| 指定用書 |
| 書名 |
自編教材
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| 作者 |
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| 書局 |
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| 年份 |
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| 國際標準書號(ISBN) |
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| 版本 |
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請同學尊重智慧財產權，使用正版教科書，不得非法影印，以免觸犯智慧財產權相關法令
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| 參考書籍 |
課本同 數位邏輯設計 參考資料： 台灣嵌入式暨單晶片系統發展協會 數位邏輯設計實用級暨專業級認證術科練習參考資料 http://www.temi.org.tw/modules/tad_uploader/index.php?of_cat_sn=7
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| 教學軟體 |
Mxplus II 與 Quartus II
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| 課程規範 |
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