課程代碼 |
30D1DO03
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課程中文名稱 |
數位邏輯設計與實習
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課程英文名稱 |
Digital Logic Design and Practice
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學分數 |
3.0
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必選修 |
必修
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開課班級 |
四技電子一丙
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任課教師 |
楊峻泓
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上課教室(時間) |
週一
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第6節
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(J501)
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週一
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第7節
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(J501)
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週一
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第8節
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(J501)
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課程時數 |
3
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實習時數 |
1
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授課語言 |
1.華語
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輔導考證 |
無
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課程概述 |
課程內容包含:.數字系統的轉換與各種數位碼表示法、邏輯閘特性、邏輯電路的化簡技術、組合邏輯電路及應用、正反器特性與序向邏輯計數器電路之設計與實習。
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先修科目或預備能力 |
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課程學習目標與核心能力之對應
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編號 | 中文課程學習目標 | 英文課程學習目標 | 對應系指標 |
1
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了解每種基本邏輯閘特性及組合邏輯電路原理。
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1 專業技能
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2
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培養邏輯系統相關工程之分析設計與實作能力。
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2 工程實務
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3
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介紹有關邏輯系統相關的網站,使學生能自行學習
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5 終身學習
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4
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藉由上台簡報,訓練學生系統整合的能力。
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7 系統整合
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就業力培養目標 |
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校指標 |
1 |
2 |
3 |
4 |
5 |
6 |
7 |
8 |
9 |
10 |
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專業知識 |
實務技能 |
資訊能力 |
整合創新 |
外語能力 |
熱誠抗壓 |
表達溝通 |
敬業合群 |
人文素養 |
服務關懷 |
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50% |
30% |
0% |
10% |
0% |
0% |
0% |
0% |
0% |
10% |
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系指標 |
1 |
2 |
3 |
4 |
7 |
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6 |
8 |
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9 |
5 |
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專業技能 |
工程實務 |
資訊能力 |
整合創新 |
系統整合 |
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熱誠抗壓 |
專案管理 |
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社會責任 |
終身學習 |
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50% |
30% |
0% |
0% |
10% |
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0% |
0% |
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0% |
10% |
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中文課程大綱 |
1.數字系統 2.基本邏輯閘與布林代數 3.邏輯電路的化簡技術 4.組合邏輯應用電路與實習 5.正反器特性與實習 6.同步計數器電路設計與實習 7.非同步計數器電路設計與實習
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英/日文課程大綱 |
1.Number System 2.Logic gates and Boolean Algebra 3.Gate-Level Minimization 4.Combinational Logic 5.Flip-Flop 6.Synchronous Counter Design and Practice 7. Asynchronous Counter Design and Practice
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課程進度表 |
第1週 介紹訊號種類 第2-3週 數值系統 第4-5週 數位邏輯電路線上模擬 第6週 基本邏輯閘與實習 第7週 布林代數 第8週 邏輯電路的化簡技術 第9週 期中考 第10週 Quartus II簡介與實習 第11-12週 組合邏輯應用電路與實習 第13-14週 循序應用電路與實習 第15-16週 計數器電路與實習 第17週 Verilog簡介 第18週 期末考
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課程融入SDGs |
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期考調查 |
期中考(第9週)考試方式 |
筆試 (視情況需上機考試)
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期末考(第18週)考試方式 |
筆試 (視情況需上機考試)
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其他週考試考試週次與方式 |
無
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教學方式與評量方式 |
課程學習目標 | 教學方式 | 評量方式 |
了解每種基本邏輯閘特性及組合邏輯電路原理。 |
課堂講授
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筆試
(
期中
)
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培養邏輯系統相關工程之分析設計與實作能力。 |
課堂講授
實作演練
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筆試
(
期末
)
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介紹有關邏輯系統相關的網站,使學生能自行學習 |
實作演練
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書面報告
(
平時
)
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藉由上台簡報,訓練學生系統整合的能力。 |
實作演練
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書面報告
(
平時
)
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指定用書 |
書名 |
數位邏輯設計
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作者 |
陳培殷/林宜民編著
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書局 |
滄海圖書
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年份 |
2017
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國際標準書號(ISBN) |
9789865647803
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版本 |
1
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請同學尊重智慧財產權,使用正版教科書,不得非法影印,以免觸犯智慧財產權相關法令
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參考書籍 |
書名 (Title): Verilog晶片設計 作者 (Author): 林灶生 書局 (Publisher): 全華 年份 (Years): 2014 國際標準書號 (ISBN): 9789572195420 版本 (Edition): 第三版
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教學軟體 |
1. 線上軟體CircuitVerse
2. Quartus II軟體
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課程規範 |
須訓練的基本能力 - 從網路及圖書館找資料 - 整理與分析資料 - 寫作能力 - 思考能力
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