| 課程代碼 |
20D18F02
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| 課程中文名稱 |
數位系統設計實務
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| 課程英文名稱 |
Digital System Design
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| 學分數 |
2.0
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| 必選修 |
必修
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| 開課班級 |
四技控晶一乙
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| 任課教師 |
龔應時
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| 上課教室(時間) |
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週四
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第5節
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(J501)
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週四
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第6節
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(J501)
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週四
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第7節
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(J501)
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| 課程時數 |
3
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| 實習時數 |
0
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| 授課語言 |
1.華語
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| 輔導考證 |
無
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| 課程概述 |
本課程是教導學生如何以FPGA設計簡單的數位系統晶片，學生需要有數位邏輯基本概念，也就是要有及閘、或閘等數位邏輯概念 再修本課程將會很容易且很輕鬆學習，修本課程學生不用需帶任何工具。
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| 先修科目或預備能力 |
數位邏輯、數位系統設計
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課程學習目標與核心能力之對應
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| 編號 | 中文課程學習目標 | 英文課程學習目標 | 對應系指標 |
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1
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瞭解FPGA晶片設計及SoPC系統
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1 工程知識
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2
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瞭解撰寫複雜工程計算之VHDL程式
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|
1 工程知識
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3
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了解簡易CPU之設計
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7 終身學習
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4
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了解以Modelsim/ Simulink之共同模擬技術
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|
1 工程知識
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| 就業力培養目標 |
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校指標 |
1 |
2 |
3 |
4 |
5 |
6 |
7 |
8 |
9 |
10 |
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專業知識 |
實務技能 |
資訊能力 |
整合創新 |
外語能力 |
熱誠抗壓 |
表達溝通 |
敬業合群 |
人文素養 |
服務關懷 |
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50% |
10% |
5% |
5% |
0% |
30% |
0% |
0% |
0% |
0% |
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系指標 |
1 |
3 |
5 |
2 |
4 |
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7 |
6 |
8 |
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工程知識 |
實務技能 |
計畫評估 |
設計實驗 |
系統整合 |
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終身學習 |
解決問題 |
適應社會 |
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50% |
5% |
5% |
5% |
5% |
|
30% |
0% |
0% |
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| 中文課程大綱 |
第一章 數位積體電路之設計發展過程
1-1 PLD簡介
1-2 CPLD與FPGA的差異
1-3 Xilinx Spartan 2E FPGA之基本架構
1-4 FPGA/CPLD 的設計流程
1-5 Xilinx ISE 發展系統簡介
1-6 使用Xilinx ISE發展系統設計FPGA與CPLD晶片操作的差異
第二章 Xilinx ISE發展系統之安裝及簡易操作
2-1 如何下載及安裝Xilinx ISE WebPACK軟體
2-2 Xilinx ISE WebPACK之操作步驟
第三章 基本邏輯閘實驗
3-1 OR、AND、NOT邏輯閘之實驗
3-2 編碼器與解多工器之實驗
3-3 解碼器與多工器
3-4 七段顯示器解碼器電路之設計
第四章 階層式電路的設計
4-1 壹位元全加器之設計
4-2 二位元全加器之設計
第五章 計數器的設計
5-1 四位元非同步上數計數之設計
5-2 不同頻率時鐘脈波產生器之設計
5-3 具有七段顯示器之四位元非同步上數計數器之設計
第六章 VHDL硬體描述語言設計方法
6-1 如何使用VHDL硬體描述語言的方式設計電路
6-2 VHDL硬體描述語言的基本架構組成
第七章 VHDL硬體描述語言之描述規則
7-1 VHDL硬體描述語言指令的命名規則
7-2 VHDL敘述的描述形式
7-3 VHDL的常用描述指令
第八章 VHDL設計實例介紹
8-1 三對八解碼器的設計
8-2 七段顯示器解碼電路之設計
8-3 上下數計數器之設計
8-4 BCD上下數計數器
8-5 以VHDL設計除頻電路
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| 英/日文課程大綱 |
1. FPGA-Based Systems
1.1 Introduction
1.2 Basic Concepts
1.3 Digital Design and FPGAs
1.4 FPGA-Based System Design
3. FPGA Fabrics
3.1 Introduction
3.2 FPGA Architectures
3.3 SRAM-Based FPGAs
3.4 Permanently Programmed FPGAs
3.5 Chip I/O
3.6 Circuit Design of FPGA Fabrics
4. Combinational Logic
4.1 Introduction
4.2 The Logic Design Process
4.3 Hardware Description Languages
4.4 Combinational Network Delay
4.5 Power and Energy Optimization
5. Sequential Machines
5.1 Introduction
5.2 The Sequential Machine Design Process
5.3 Sequential Design Styles
5.4 Rules for Clocking
5.5 Performance Analysis
6. Architecture
6.1 Introduction
6.2 Behavioral Design
6.3 Design Methodologies
6.4 Design Example
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| 課程進度表 |
一、順序邏輯VHDL語言設計(3hrs)
二、閂鎖器、正反器與計時器(12hrs)
三、位移暫存器(3hrs)
四、計數器(3hrs)
五、閂鎖器、正反器與計時器之電路模擬(12hrs)
六、位移暫存器之電路模擬(6hrs)
七、計數器之電路模擬(6hrs)
八、範例(3hrs)
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| 課程融入SDGs |
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| 期考調查 |
| 期中考(第9週)考試方式 |
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| 期末考(第18週)考試方式 |
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| 其他週考試考試週次與方式 |
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| 教學方式與評量方式 |
| 課程學習目標 | 教學方式 | 評量方式 |
| 瞭解FPGA晶片設計及SoPC系統 |
課堂講授
|
設計製作
（
平時
）
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| 瞭解撰寫複雜工程計算之VHDL程式 |
課堂講授
|
設計製作
（
平時
）
筆試
（
期中
）
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| 了解簡易CPU之設計 |
課堂講授
|
設計製作
（
平時
）
|
| 了解以Modelsim/ Simulink之共同模擬技術 |
課堂講授
|
設計製作
（
平時
）
筆試
（
期末
）
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| 指定用書 |
| 書名 |
數位邏輯設計
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| 作者 |
Thomas L. Floyd (黃炳森,黃金本)
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| 書局 |
高立圖書
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| 年份 |
2016
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| 國際標準書號(ISBN) |
978-986-280-328-8
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| 版本 |
第十一版
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請同學尊重智慧財產權，使用正版教科書，不得非法影印，以免觸犯智慧財產權相關法令
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| 參考書籍 |
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| 教學軟體 |
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| 課程規範 |
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